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Enregistrement W1796445194 · doi:10.1109/cicc.1994.379764

An overview of technology, architecture and CAD tools for programmable logic devices

2002· article· en· W1796445194 sur OpenAlexaff
S. D. Brown

Notice bibliographique

Revuenon disponible
Typearticle
Langueen
DomaineEngineering
Thématique3D IC and TSV technologies
Établissements canadiensUniversity of Toronto
Organismes subventionnairesnon disponible
Mots-clésProgrammable Array LogicProgrammable logic deviceSimple programmable logic deviceProgrammable logic arrayComputer scienceErasable programmable logic deviceField-programmable gate arrayLogic synthesisLogic familyMacrocell arrayComputer architectureComplex programmable logic deviceLogic gateDigital electronicsEmbedded systemRegister-transfer levelElectronic circuitComputer hardwareElectrical engineeringEngineeringAlgorithm

Résumé

récupéré en direct d'OpenAlex

Before the advent of programmable logic devices (PLDs), most digital hardware designs included significant numbers of small-scale integrated (SSI) circuits that comprised basic logic gates and flip-flops. However, modem designs contain virtually none of these low-density parts, but instead are built from more complex devices that consist of an uncommitted array of logic gates and memory elements that can be configured by the user to implement different circuits. The term programmable logic device is not easy to define because the assortment of chips that fall within this broad category, namely any integrated circuit that is programmable by the end user and intended for implementing hardware, has grown very large over the past few years. In fact, even the relevant terminology has become nebulous because of rapid technology changes and the introduction of new innovative architectures. The purpose of this paper is to provide an overview of programmable logic devices in order to present the reader with a clear view of what is available on the market today. The fundamental technologies employed to manufacture PLDs are presented, after which for each of the three categories of chips, namely simple programmable logic devices (SPLDs), complex programmable logic devices (CPLDs), and field-programmable gate arrays (FPGAs), the paper describes the most significant architectural features, examples of applications, and the CAD tool design now typically used when implementing circuits.>

Récupéré en direct depuis OpenAlex et désinversé. Les résumés ne sont pas conservés dans cette base de données : les index inversés représentent 8,6 Go des 9,3 Go de texte de la base, et le serveur dispose de 13 Go libres.

Comment cette classification a été obtenuedéplier

Prédiction machine sur la base complète

Imitation des enseignants

Ni prévalence calibrée, ni vérité terrain. Validation humaine à venir. Le volet Gemma est une étiquette directe du modèle pour chaque travail de la base, lue sur la notice réduite au titre. Le volet Codex est un classifieur appris des 10 348 étiquettes directes de Codex et calibré sur les taux pondérés de l'échantillon; les champs sans appui suffisant ne portent aucun appel Codex. Le mode candidate est l'union des deux volets; le consensus est leur intersection. Ces sorties portent le statut machine_predicted_unvalidated et ne sont pas des étiquettes humaines.

score de la tête « metaresearch » (Codex)0,001
score de la tête « metaresearch » (Gemma)0,001
Version: metacan-v3-hybrid-931329e0061cStatut de validation: machine_predicted_unvalidated
Catégories candidatesaucune
Catégories consensuellesaucune
DomaineSignal candidat: aucune · Signal consensuel: aucune
Devis d'étudeSignal candidat: Sans objet · Signal consensuel: aucune
GenreSignal candidat: Synthèse · Signal consensuel: aucune
Score de désaccord entre enseignants0,017
Score d'incertitude au seuil0,058

Scores du classifieur distillé par catégorie (deux têtes)

CatégorieCodexGemma
Métarecherche0,0010,001
Méta-épidémiologie (sens strict)0,0010,001
Méta-épidémiologie (sens large)0,0010,001
Bibliométrie0,0030,004
Études des sciences et des technologies0,0010,001
Communication savante0,0030,004
Science ouverte0,0020,001
Intégrité de la recherche0,0020,002
Charge utile insuffisante (le modèle a refusé de juger)0,0170,012

Scores machine (provisoires)

Les deux têtes enseignantes du modèle étudiant, lues sur ce travail. Un score ordonne la base pour la relecture; il n'affirme jamais une catégorie, et le statut de validation accompagne chaque rangée tel quel.

Scores de référence d'un modèle non mature (critères de maturité non atteints, 7 itérations). Un score ordonne; il n'affirme jamais une catégorie.

Tête enseignante Opus0,061
Tête enseignante GPT0,275
Écart entre enseignants0,214 · la distance entre les deux têtes enseignantes sur ce seul travail
Statut de validationscore_only:v0-immature-baseline · tel quel depuis la passe de notation : score_only signifie que le nombre peut ordonner les travaux, et qu'aucune étiquette de catégorie n'en découle

Classification

machine, non validée

Prédiction automatique; un appel candidat d’une seule source (Gemma direct ou Codex distillé), pas un consensus.

Les modèles n’ont appliqué aucune catégorie : rien dans la taxonomie ne correspondait à ce travail.
Devis d'étudeSans objet
Domainenon disponible
GenreSynthèse

Le détail, modèle par modèle et score par score, se trouve en fin de page sous « Comment cette classification a été obtenue ».

En bref

Citations18
Publié2002
Routes d'admission1
Résumé présentoui

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