An Energy-Efficient Cache Architecture for Chip-Multiprocessors Based on Non-Uniformity Accesses
Notice bibliographique
Résumé
With technology scaling and increasing parallelism levels of new embedded applications, number of cores in chip-multiprocessors (CMPs) has been shifted from 100 to 1000 cores. To efficiently store and manipulate of large amount of data in future applications and, also, decreasing the gap between cores and off-chip memory accesses, the size of cache systems in CMPs has been dramatically increased. Since on-chip storage systems, particularly last level caches, occupy as much as 50% of the chip area, they are dominant leakage power consumer in future multi/many-core systems. In this context, power consumption becomes a primary concern in future CMPs because many of them are generally limited by battery lifetime. For future CMPs architecting, 3D stacking of last level caches (LLCs) has been recently introduced as a new methodology to combat to performance challenges of 2D integration and memory wall. However, the 3D design of LLCs incurs more leakage energy consumption compared to conventional cache architectures in 2Ds due to dense integration. In this paper, we use the non-uniform distribution of the accesses in banks of LLCs to decrease leakage energy. We propose a runtime cache architecture. The proposed architecture that is based on nonuniform cache architectures (NUCA) disables cache banks that have low accesses and leads to high energy-efficiency. The experimental results show that the proposed method improves energy-delay product by about 41% on average under PARSEC benchmarks compared to a recent technique named EECache.
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Comment cette classification a été obtenuedéplier
Prédiction distillée sur la base complète
Imitation des enseignantsNi prévalence calibrée, ni vérité terrain. Validation humaine à venir. Apprise à partir de 10 348 étiquettes directes de Codex et de 10 348 étiquettes directes de Gemma. Le mode candidate est l'union des têtes enseignantes seuillées; le consensus est leur intersection. Ces sorties portent le statut machine_predicted_unvalidated et ne sont ni des étiquettes humaines ni des étiquettes directes de modèles de pointe.
Scores Codex et Gemma par catégorie
| Catégorie | Codex | Gemma |
|---|---|---|
| Métarecherche | 0,000 | 0,000 |
| Méta-épidémiologie (sens strict) | 0,000 | 0,000 |
| Méta-épidémiologie (sens large) | 0,000 | 0,000 |
| Bibliométrie | 0,000 | 0,000 |
| Études des sciences et des technologies | 0,000 | 0,000 |
| Communication savante | 0,000 | 0,000 |
| Science ouverte | 0,001 | 0,000 |
| Intégrité de la recherche | 0,000 | 0,000 |
| Charge utile insuffisante (le modèle a refusé de juger) | 0,000 | 0,000 |
Scores machine (provisoires)
Les deux têtes enseignantes du modèle étudiant, lues sur ce travail. Un score ordonne la base pour la relecture; il n'affirme jamais une catégorie, et le statut de validation accompagne chaque rangée tel quel.
Scores de référence d'un modèle non mature (critères de maturité non atteints, 7 itérations). Un score ordonne; il n'affirme jamais une catégorie.
score_only:v0-immature-baseline · tel quel depuis la passe de notation : score_only signifie que le nombre peut ordonner les travaux, et qu'aucune étiquette de catégorie n'en découleClassification
machine, non validéePrédiction automatique; un appel candidat d’une seule tête enseignante, pas un consensus.
Le détail, modèle par modèle et score par score, se trouve en fin de page sous « Comment cette classification a été obtenue ».